Zen4架構(gòu)銳龍7000放出更多細節(jié) 將搭載AM5接口及DDR5內(nèi)存

綜合多方爆料，一份新修正的AMD客戶端處理器的路線圖曝光。

此前所謂Zen4架構(gòu)銳龍?zhí)幚砥?代號Raphael，拉斐爾)集成的Navi 2核心GPU有了明確身份確認，就是RDNA2。

除此之外，Zen4還將提供對PCIe 5.0、DDR5內(nèi)存的支持、新的AM5接口等。

按照此前的猜測，Zen4 Raphael之所以能塞入GPU原因在于接口變化、5nm工藝晶體管密度更大、I/O Die升級到6nm等，從而為GPU留下空間。

當然，Zen4之前AMD可能使用6nm Zen3+做過度，并且完整覆蓋桌面和筆記本。

我們知道，Zen3相較于Zen2實現(xiàn)了多達19%的IPC(每時鐘周期指令集，某種意義上可理解為單核)提升，去年AMD執(zhí)行副總裁Rick Bergman被問到Zen4能否擁有類似的IPC增幅，他的答案是“考慮到現(xiàn)在x86體系結(jié)構(gòu)的成熟程度，答案必須是有過之而無不及”。在Zen4上，緩存、分支預測、流水線等都再次優(yōu)化。

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